摘 要：針對IEEE-754標(biāo)準(zhǔn)浮點(diǎn)指數(shù)運(yùn)算" title="指數(shù)運(yùn)算">指數(shù)運(yùn)算的要求，通過對現(xiàn)有的幾種指數(shù)運(yùn)算硬件實(shí)現(xiàn)方法的分析，結(jié)合牛頓迭代" title="牛頓迭代">牛頓迭代原理推導(dǎo)出一種新的按指數(shù)速度收斂的算法，并用Verilog HDL語言實(shí)現(xiàn)了一個精度為56位的指數(shù)運(yùn)算單元。該算法通過查表" title="查表">查表和乘法來實(shí)現(xiàn)迭代操作，并通過增加迭代次數(shù)來降低查找表" title="查找表">查找表的大小。所實(shí)現(xiàn)的運(yùn)算單元采用九級流水線結(jié)構(gòu)，工作頻率可以達(dá)到200MHz。
關(guān)鍵詞：指數(shù)運(yùn)算? 牛頓迭代? 查表? 浮點(diǎn)
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一種基于牛頓迭代的快速收斂指數(shù)算法的設(shè)計(jì)與實(shí)現(xiàn)" title="設(shè)計(jì)與實(shí)現(xiàn)">設(shè)計(jì)與實(shí)現(xiàn).pdf
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