SuperH RISC engine 族CPU 是RISC （Reduced Instruction Set Computer）結構的CPU。基本指令以1 條指令1 個狀態運行，實現了高性能的運算處理。并且內置乘法器，可進行與通用DSP （Digital Signal Processor：數字信號處理器）相同的乘法和乘法累加運算。
瑞薩SuperH RISC engine （以下簡稱SuperH）族有SH-1、SH-2、SH-3、SH-DSP、SH3-DSP、SH-4 等CPU 內核。
SH-1、SH-2、SH-3、SH-4 的各CPU 有2 進制級高位兼容的指令體系。
SH-DSP 以SH-2 CPU 為基礎，是實現了與通用DSP 相同信號處理性能的32 位微控制器。SH-DSP 強化了SuperH RISC engine 中乘法和乘法累加運算的DSP 功能，可實現DSP 類的數據總線功能。SH-DSP 與SH-1、SH-2 單片機在2 進制級高位兼容（參考圖1）。該編程手冊記載了SH-1、SH-2、SH-DSP 的基本體系結構和指令詳細內容，便于理解體系結構和指令的操
作，同時也記載了SuperH RISC engine 的特點——流水線運行。
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