基于FPGA的雷達恒虛警模塊的設計
所屬分類:參考設計
上傳者:aet
文檔大小:485 K
標簽: FPGA
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文檔介紹:恒虛警處理技術(shù)可以使雷達在保持較高發(fā)現(xiàn)概率的同時,降低虛警概率。為了提高機載雷達在雜波與噪聲背景條件下發(fā)現(xiàn)目標的能力,針對復雜統(tǒng)計模型應用的局限性,提出了一種基于FPGA的恒虛警模塊的設計思想,并在軟件平臺環(huán)境下,對設計方法的可行性進行了仿真驗證。
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