| 基于FPGA中斷管理的研究及硬件化設計 | |
| 所屬分類：參考設計 | |
| 上傳者：aet | |
| 文檔大?。?span>481 K | |
| 標簽： FPGA | |
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| 文檔介紹：為了滿足嵌入式操作系統中實時性要求，提出了基于FPGA的中斷管理方法。給出了中斷管理模塊的結構模型，并采用VHDL硬件描述語言將中斷管理模塊由硬件實現。針對中斷請求和響應方式的不同特點，將其分為系統中斷管理和用戶中斷管理，主要設計了中斷源、中斷嵌套和時鐘節拍中斷等管理的邏輯電路。通過仿真實驗表明，該結構模型所采用的中斷管理方法是正確的，提高了中斷處理速度，可滿足系統的實時性要求。 | |
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